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2013-05-23 12:21
求翻譯:This paper presents the design of a universal asynchronous receiver and transmitter (UART), which is fully functional and synthesizeable. Due to its modularity, configurability and extremely compact size, the proposed UART is named as micro-UART and it is ideal for system-on-a-chip (SoC) application. The core is usable是什么意思?![]() ![]() This paper presents the design of a universal asynchronous receiver and transmitter (UART), which is fully functional and synthesizeable. Due to its modularity, configurability and extremely compact size, the proposed UART is named as micro-UART and it is ideal for system-on-a-chip (SoC) application. The core is usable
問題補充: |
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2013-05-23 12:21:38
本文介紹了通用異步接收器和發射器(UART),這是全面的功能和可綜合的設計。由于其模塊化,可配置性和極其緊湊的尺寸,建議UART被命名為微UART,它是單芯片系統(SOC)應用的理想選擇。核心可用作知識產權。已被用于其設計,編譯和仿真Verilog硬件描述語言(HDL)在Altera的MAX-PLUS II環境。已實施的UART使用Altera的FPGA技術。 ?2004愛思唯爾有限公司。保留所有權利。關鍵字:UART; HDL; FPGA; SOC;串行通信
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2013-05-23 12:23:18
本文介紹了設計的一個通用異步接收器 發送器(uart),這是完全正常和synthesizeable。 由于它的模塊化設計、可配置性和極其緊湊的尺寸,uart是命名的建議作為微型uart和它是一個很理想的片上系統(soc)應用程序。 其核心是用作一個知識產權。 verilog硬件描述語言(hdl)在altera的最大的環境加上二一直使用其設計、編譯和仿真模擬。
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2013-05-23 12:24:58
本文提出一臺普遍異步接收器和發射機(UART的)設計,充分地工作和synthesizeable。 由于它的模塊化、可配置性和極端袖珍型,提出的UART被命名,因為微UART和它為系統在芯片(SoC)應用是理想的。 核心是能用的作為知識產權。 Verilog硬件描述語言(HDL)在Altera的MAX-PLUS II環境里為它的設計、編輯和模仿使用了。 UART使用Altera的FPGA技術被實施了。 ?2004 Elsevier有限公司。 版權所有。 主題詞: UART; HDL; FPGA; SoC; 串行通信
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2013-05-23 12:26:38
本文介紹通用異步收發 (UART),這是完全功能和 synthesizeable 的設計。由于其模塊化、 可配置性和非常緊湊的大小,擬議的 UART 命名為微 UART 和它是系統上-芯片 (SoC) 應用的理想選擇。核心是可用作為知識產權。Altera MAX-PLUS II 環境語言硬件描述語言 (HDL) 被用于其設計、 匯編和仿真。已使用的 Altera FPGA 技術實施 UART。? 2004 Elsevier 有限公司保留所有的權利。關鍵字: UART ;高密度脂蛋白 ;FPGA ;SoC ;串行通訊
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2013-05-23 12:28:18
這篇文章贈送一位宇宙異步性的接收者和傳送者的作品 (UART),是全功能和可合成的。由于其模塊性,可配置性和非常緊湊的大小,擬議的 UART 命名被為微 UART 和它是適用于系統芯片 ( SoC ) 申請。核心是可用的作為知識產權。Verilog 硬件描述語言 (HDL) 在 Altera 的最大以上 II 種環境中用于了其設計,編輯和模擬。UART 使用 Altera 的 FPGA 技術被實施了。(C)2004 年 Elsevier Ltd.All 權利保留。關鍵字:UART ;HDL ;FPGA ;SoC ;連續通信
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